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100G UDP/IP 協議棧 FPGA IP Core 核 萬兆以太網絡加速 AXI4-Stream MAC+PCS/PMA

  • 產品型號

    100G UDP/IP
  • 產地

    上海

產品推薦


100G 萬兆以太網 UDP/IP 協議棧 FPGA IP Core

基于 AMD/Xilinx 100G 以太網 MAC IP 開發,MTU 支持高達 9000Bytes 數據傳輸,標準的 AXI4-Stream 接口,支持 AMD/Xilinx Zynq UltraScale+ RFSoC, Zynq UltraScale+ MPSoC, Virtex UltraScale+, Kintex UltraScale+, Artix UltraScale+ 系列 FPGA 器件。100G 萬兆以太網以其高帶寬和低延遲的特點,能夠確保數據的快速傳輸和實時處理,而 TUDP 協議棧更是提高了數據傳輸的效率和準確性。

為您提供了快速可靠、更低成本和更高性能的解決方案,顯著縮短上市時間,適用于高帶寬、低延遲和高速數據傳輸的場景,如數據中心、科研實驗、工業自動化、醫療、測試與測量、4K/8K 高清視頻傳輸、電信、金融交易等領域。

  • · IEEE802.3 標準

    符合 IEEE802.3 標準的 ARP、IPV4、ICMP、UDP 協議棧

  • · UDP/IP 校驗處理

    快速傳輸,實時處理,支持 UDP/IP 校驗和處理

  • · AXI4 Stream

    用戶接口和 Ethernet MAC+PCS/PMA IP 接口為標準 AXI4-Stream 接口

  • · 10 ARP 表緩存

    ARP 報文應答支持所有查詢應答,可緩存 10 ARP 表

  • · 至高 9000Bytes 數據傳輸

    MTU 支持 9000Bytes ~ 64Bytes 數據傳輸

  • · 高帶寬、低延遲

    數據總線寬度 512bit,322.266MHz 時鐘

  • · Verilog

    Verilog 代碼解決方案

  • · Vivado 2020.1

    開發工具


功能特點

  • ? 根據 OSI 分層模型實現符合 IEEE802.3 標準的 ARP、IPV4、ICMP、UDP 協議棧

  • ? 支持 ARP,用于獲取或發送 MAC 地址

  • ? 支持 ICMP,用于響應 Ping 命令

  • ? ARP 報文應答支持所有來查詢的應答,可以緩存 10 個 ARP 表

  • ? ARP 表未建立時,不會發送 UDP 數據包

  • ? 100Gbps 以太網連接,支持 UDP/IP 校驗和處理,CRC 由 MAC IP 計算產生

  • ? 基于 AMD/Xilinx 100G MAC IP 開發,MTU 支持 9000Bytes ~ 64Bytes 數據傳輸

  • ? 用戶接口為 AXI4 stream 接口,協議棧利用以太網 MAC IP產生的時鐘 322.266MHz,100Gbps 數據總線寬度 512bit

100G以太網MAC-UDP_IP協議棧FPGA-IP-Core-核-庫-AXI1.jpg


應用結構示例圖

UDP/IP 協議棧 IP Core 與用戶接口、Ethernet MAC+PCS/PMA IP 接口均為標準的 AXI4-Stream 接口,其中 Ethernet MAC+PCS/PMA 可以是任何第三方 IP,在提供的設計實例中,使用的是 AMD/Xilinx 100G Ethernet Subsystem IP

100G-UDP-FPGA-IP-Core-核-庫--AXI萬兆以太網MAC-網絡加速.jpg

UDP/IP 協議棧 IP Core 集成在系統設計中的位置



開發環境

設計語言

Verilog

開發工具

Vivado 2020.1

支持器件

AMD Virtex Ultrascale+/Kintex UltraScale+/Artix UltraScale+ 系列
AMD Zynq UltraScale+ MPSoC/Zynq UltraScale+ RFSoC 系列


IP 資源消耗表

IP 資源消耗評估采用 AMD Kintex UltraScale+ 系列 FPGA 開發板,提供了一個功能齊全的設計平臺,用于構建以通信為中心的以太網應用。Kintex UltraScale+ XCKU15P 開發板提供了一個帶有參考設計的開箱即用型硬件平臺,可縮短開發時間,讓您專注于目標應用。

器件系列

Kintex UltraScale+

芯片型號

XCKU15P-FFVE1517

頻率 (MHz)

322.266

CLB Regs

27711

CLB LUTs

17586

CLB

3687

BRAM Tile

26

URAM

0

Design Tools

Vivado 2020.1

注:IP 實際邏輯資源消耗受實例化中其他邏輯資源消耗影響


應用領域

100G UDP/IP 協議棧網絡加速 FPGA IP Core 主要適用于需要高帶寬、低延遲和高速數據傳輸的場景,如數據中心、科研實驗、工業自動化、醫療、測試與測量、4K/8K 高清視頻傳輸、電信、金融交易等領域。

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