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ISP FPGA 圖像信號處理 IP Core

  • 產品型號

    ISP

產品推薦


ISP 圖像信號處理 IP Core

ISP IP Core 通過APB總線用于控制寄存器,支持 UltraScale+ / Zynq UltraScale+ 系列 FPGA 器件

ISP IP Core 為您提供了快速可靠、更低成本和更高性能的解決方案,顯著縮短上市時間,適用于高清圖像視頻處理、智能視覺的場景,如醫療內窺鏡、手術機器人、工業相機、汽車自動駕駛、無人機、機器人、AR/VR、智慧城市、智能交通、安防監控等領域

  • · 超高頻率

    每時鐘周期處理1個像素,最高頻率 300Mhz

  • · 更省資源

    APB 總線控制寄存器,比 AXI Lite 總線 更省資源

  • · 微秒級延時

    低延時,采用行緩存,延時微秒級

  • · 4K 視頻圖像

    最大分辨率支持 4096x2048

  • · 靈活組合

    可靈活組合各個模塊

  • · 快速上手,技術支持

    FPGA Vivado、Verilog 代碼解決方案


功能特點

  • ? 每時鐘周期處理一個像素,最高頻率300Mhz

  • ? 最大分辨率支持 4096x2048

  • ? 可靈活組合各個模塊

  • ? 低延時,采用行緩存,延時微秒級

  • ? 黑電平校正(BLC)

  • ? 自動白平衡(AWB)

  • ? 去馬賽克(demosaic)

  • ? 顏色矯正矩陣(CCM)

  • ? Gamma 矯正

  • ? 顏色空間轉換(CSC)

  • ? 邊沿增強(EE)

  • ? APB 總線控制寄存器,比 AXI Lite 總線更省資源

  • ? 行場同步視頻總線數據輸入輸出

ISP視頻圖像信號處理-FPGA-IP-Core核.jpg


基本 ISP 處理流程

ISP 是一種專門用于處理圖像信號的技術,可以對從圖像傳感器獲取的原始數據進行處理。ISP 結合ARM處理器的圖像信號處理系統,使用 APB 控制寄存器,控制黑電平校正(BLC)、自動白平衡(AWB)、去馬賽克(demosaic)、顏色矯正矩陣(CCM)、Gamma 矯正、顏色空間轉換(CSC)、邊沿增強(EE)、2D 降噪等模塊,靈活組合。


基本ISP處理流程-FPGA-IP-Core核.jpg



開發環境

設計語言

Verilog

開發工具

Vivado 2020.1

支持器件

AMD Virtex Ultrascale+/Kintex UltraScale+/Artix UltraScale+ 系列
AMD Zynq UltraScale+ MPSoC/Zynq UltraScale+ RFSoC 系列


IP 資源消耗表

IP 資源消耗評估采用 AMD Zynq UltraScale+ MPSoC 系列 FPGA 開發板,提供了一個功能齊全的設計平臺,用于構建數據存儲加速應用。Zynq UltraScale+ MPSoC XCZU5EV FPGA 開發板提供了一個帶有參考設計的開箱即用型硬件平臺,可縮短開發時間,讓您專注于目標應用。

器件系列

Zynq UltraScale+ MPSoC

芯片型號

XCZU5EV-2SFVC784I

頻率 (MHz)

300

CLB Regs

22161

CLB LUTs

18541

CLB

3969

BRAM Tile

33

Design Tools

Vivado 2020.1

注:IP 實際邏輯資源消耗受實例化中其他邏輯資源消耗影響


應用領域

ISP FPGA IP Core  主要適用于高清圖像視頻處理、智能視覺的場景,如醫療內窺鏡、手術機器人、工業相機、汽車自動駕駛、無人機、機器人、AR/VR、智慧城市、智能交通、安防監控等領域的場景。

醫療內窺鏡、手術機器人.jpg

醫療內窺鏡、手術機器人

工業自動化.png

工業視覺

機器人、無人機.png

機器人、無人機

汽車自動駕駛.png

汽車自動駕駛

智慧城市交通.png

智慧城市交通

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安防監控

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